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Verwendung als I
C-Schnittstelle
Die "SPI / I2C"-Stiftleiste wird beim Einsatz der optio-
nalen ADC-Aufsteckplatine benutzt, um die Digital-
werte an den DSP zu übertragen, siehe auch
Kapitel 4.4.8 "Analog-Eingänge (optional)", Seite
Die I²C-Taktsignale (SCL an Pin (1)) und I²C-Daten-
signale (SDA an Pin (2)) sind derzeit nicht anderweitig
frei verfügbar.
Verwendung als SPI-Schnittstelle
Die "SPI / I2C"-Stiftleiste kann bei Bedarf für eine
serielle synchrone Datenübertragung eingestellt
werden. Es wird dann die SPI-Funktionalität statt der
McBSP-Funktionalität (Voreinstellung) verwendet.
Dazu kann jederzeit der Befehl
aufgerufen werden. Eine laufende Datenübertragung
wird dadurch abgebrochen. Mit
vorherige Zustand (McBSP-Funktionalität) wieder
hergestellt werden.
Nach der Initialisierung kann pro 10 µs nur ein
Datenwort übertragen werden (siehe z.B.
set_mcbsp_in).
Die voreingestellte Übertragungsfrequenz ist 8 MHz
(4 µs pro Datenwort). Alternativ kann ein Wert aus
dem Bereich von 4...16 MHz eingestellt werden.
Dazu wird der Befehl
set_mcbsp_freq
mcbsp_init
oder mcbsp_init_spi).
(siehe auch
Nach dem Aufruf des Befehls
®
fungiert die RTC
5 im Sinne des SPI-Standards als
SPI-Master Device. Die RTC
nur einen SPI-Slave. Für den Betrieb sind notwendig:
• 1 Steuerleitung für das Taktsignal
(CLKX0 an Pin (3))
• 1 Steuerleitung für das low-aktive Slave-Select-
Signal (FSX0 an Pin (5))
• 1 Datenleitung - aus Sicht des Masters -
ausgehend (DX0 an Pin (7))
• 1 Datenleitung - aus Sicht des Masters -
eingehend (DR0 an Pin (8))
Pin (4) CLKR0 und Pin (6) FSR0 werden nicht ange-
schlossen.
Für alle Pegelsignale gilt die Spezifikation 3,3 V TTL
oder 5 V TTL.
Die Signalabfolge ist wie beim McBSP-Mode, jedoch
sind XDelay und RDelay immer = 1.
®
Zur Verschaltung der RTC
Device siehe
Abb.
23.
®
®
RTC
5 PCI-Karte, RTC
5 PCI-Express-Karte, RTC
Rev. 1.10 d
4 Layout und Schnittstellen
59.
mcbsp_init_spi
mcbsp_init
kann der
aufgerufen
mcbsp_init_spi
®
5 ist ein Master Device für
5 mit einem SPI-Slave
®
5 PC/104-Plus-Karte, RTC
SPI Master
SCL (1)
RTC © 5
CLKX0 (3)
FSX0 (5)
DX0 (7)
GND (9)
SCLK SS MOSI MISO
SPI Slave
(Konformes
Gerät)
®
RTC
5 als SPI-Master mit SPI-Slave – Signale und Verschaltung.
SCLK = Serial Clock, MOSI = Master Output - Slave Input, MISO =
Master Input - Slave Output, SS = Slave Select. Anmerkung: In der
Literatur sind die relevanten Abkürzungen und Benennungen unein-
heitlich, d.h. es gibt für die hier Gewählten eine Vielzahl von
Synonymen.
Im Gegensatz zur McBSP-Datenübertragung erfolgen
bei SPI Dateneingang und Datenausgang synchron
mit einem gemeinsamen, vom SPI-Master gene-
rierten Taktsignal. Das SPI Timing-Diagramm ist in
Abb. 24
dargestellt.
Mit dem Befehl
mcbsp_init_spi
naleigenschaften 'Polarität' (ClockLevel) und
'Phase' (ClockDelay) eingestellt werden. Daraus
ergeben sich die gemäß SPI-Standard mit
Mode 0...Mode 3 bezeichneten Übertragungs-
formate, siehe nachfolgende Tabelle.
SPI-
Polarität des
Mode
Taktsignals
0
ist LOW wenn
inaktiv –
ClockLevel=0
1
ist LOW wenn
inaktiv –
ClockLevel=0
2
ist HIGH wenn
inaktiv –
ClockLevel>0
3
ist HIGH wenn
inaktiv –
ClockLevel>0
Alle Signale beziehen sich auf die PC-Masse GND.
®
5 PCIe/104-Karte
(2) SDA
(4) CLKR0
(6) FSR0
(8) DR0
(10) 3.3 V
23
können die Taktsig-
Phase des
Taktsignals
ist zeitgleich mit den
Datenbits –
ClockPhase=0
ist um ein halbes Takt-
signal verzögert –
ClockPhase>0
ist zeitgleich mit den
Datenbits –
ClockPhase=0
ist um ein halbes Takt-
signal verzögert –
ClockPhase>0
57
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