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Pro I: Digital-IO- und Zählermodule
Pro-DIO-32 Rev. A
82
5.6.1 Pro-DIO-32 Rev. A
Zu diesem Modul gibt es das verbesserte Nachfolgermodul
(siehe
Seite
84).
Das digitale Ein-/Ausgangsmodul
bare Ein- und Ausgangskanäle mit TTL-Pegel bereit. Die Kanäle können ein-
zeln mit ADbasic-Befehlen als Ein- oder Ausgänge konfiguriert werden. Nach
dem Einschalten sind alle Kanäle als Eingänge konfiguriert.
0
1
2
3
30
31
EVENT
Abb. 148 –
Dig. Ein-/Ausg., Bit 1
Dig. Ein-/Ausg., Bit 3
Dig. Ein-/Ausg., Bit 5
Dig. Ein-/Ausg., Bit 7
Dig. Ein-/Ausg., Bit 9
Dig. Ein-/Ausg., Bit 11
Dig. Ein-/Ausg., Bit 13
Dig. Ein-/Ausg., Bit 15
Dig. Ein-/Ausg., Bit 17
Dig. Ein-/Ausg., Bit 19
Dig. Ein-/Ausg., Bit 21
Dig. Ein-/Ausg., Bit 23
Dig. Ein-/Ausg., Bit 25
Dig. Ein-/Ausg., Bit 27
Dig. Ein-/Ausg., Bit 29
Dig. Ein-/Ausg., Bit 31
Abb. 149 –
Abb. 150 –
Pro-DIO-32 Rev.
Pro-DIO-32 Rev. A
10k
10k
10k
10k
Data
Register
10k
10k
Pro-DIO-32 Rev.
A: Blockschaltbild
Dig. Ein-/Ausg., Bit 0
19
37
Dig. Ein-/Ausg., Bit 2
18
36
Dig. Ein-/Ausg., Bit 4
17
35
Dig. Ein-/Ausg., Bit 6
16
34
Dig. Ein-/Ausg., Bit 8
15
33
Dig. Ein-/Ausg., Bit 10
14
32
Dig. Ein-/Ausg., Bit 12
13
31
Dig. Ein-/Ausg., Bit 14
12
30
Dig. Ein-/Ausg., Bit 16
11
29
Dig. Ein-/Ausg., Bit 18
10
28
Dig. Ein-/Ausg., Bit 20
9
27
Dig. Ein-/Ausg., Bit 22
8
26
Dig. Ein-/Ausg., Bit 24
7
25
Dig. Ein-/Ausg., Bit 26
6
24
Dig. Ein-/Ausg., Bit 28
5
23
Dig. Ein-/Ausg., Bit 30
4
22
DGND
3
DGND
21
reserviert
2
EVENT-Eingang
20
DGND
1
Pro-DIO-32 Rev.
A: Pinbelegung
FPGA
FPGA
ON
LS19
1 2 3 4 5 6 7 8
A0 A1 A2 A3 A4 A5 A6 A7
A: Platine und Frontplatte
ADwin-Pro Hardware, Handbuch April 2015
ADwin
Pro-DIO-32 Rev. B
stellt 32 programmier-
Data
10k
DIO 32
DIGITAL I/O
19DIO01
TTL COMP.
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