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Siemens ERTEC 200 Handbuch Seite 83

Enhanced real-time ethernet controller
Inhaltsverzeichnis

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LBU_P0_RG_H
LBU_P1_RG_H
LBU_P2_RG_H
LBU_P3_RG_H
Beschreibung
High Wort des LBU Pagex_Range_registers
Bit-Nr
Name
15..0
LBU_P0_OF_L
LBU_P1_OF_L
LBU_P2_OF_L
LBU_P3_OF_L
Beschreibung
Low Wort des LBU Pagex_Offset_registers
Bit-Nr
Name
15..0
LBU_P0_OF_H
LBU_P1_OF_H
LBU_P2_OF_H
LBU_P3_OF_H
Beschreibung
High Wort des LBU Pagex_Offset_registers
Bit-Nr
Name
15..0
LBU_P0_CFG
LBU_P1_CFG
LBU_P2_CFG
LBU_P3_CFG
Beschreibung
Konfiguration für die einzelnen Pages
Bit-Nr
Name
15..1
0
PAGE_X_32
Copyright © Siemens AG 2010. All rights reserved.
Änderungen vorbehalten
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
Beschreibung
Obere 16 Bit für Bereichseinstellung
15:6 sind nur lesbar (Wert: 000h)
5:0 sind schreib- und lesbar
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
Beschreibung
Untere 16 Bit für Offseteinstellung
15:8 sind schreib- und lesbar
7:0 sind nur lesbar (Wert: 00h)
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
Beschreibung
Obere 16 Bit für Offseteinstellung
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
W/R
Addr.:
LBU_CS_R_N
Beschreibung
Reserviert
1: Page ist 32-Bit Page
0: Page ist 16-Bit Page
+0x02
Default: 0x0000_0001 (64 k)
+0x12
Default: 0x0000_0010 (1M)
+0x22
Default: 0x0000_0020 (2M)
+0x32
Default: 0x0000_0000 (2 k)
+0x04
Default: 0x0000_0000
+0x14
Default: 0x0000_0000
+0x24
Default: 0x0000_0000
+0x34
Default: 0x0000_2000
+0x06
Default: 0x0000_1010 (KRAM)
+0x16
Default: 0x0000_1000 (IRT-Reg)
+0x26
Default: 0x0000_3000 (EMIF)
+0x36
Default: 0x0000_4000 (Periph.)
+0x08
Default: 0x0000_0000 (16Bit)
+0x18
Default: 0x0000_0001 (32Bit)
+0x28
Default: 0x0000_0000 (16Bit)
+0x38
Default: 0x0000_0001 (32Bit)
83
ERTEC 200 Handbuch
Version 1.1.2

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