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Der Datenseperator 9229B - Graf Elektronik FLO3 Handbuch

Der fioppy-controller für den ndr-computer und den sb-computer
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m =
0
Einen Record bearbeiten;
m =
1
Mehrere bearbeiten
aO
Data Adress Mark
aO
=
0
FB
(Data Mark)
aO
=
1
F8
(Delete
Data Mark)
E
15 ras Delay
(bei
Head Load)
E = 0
keine
15 ms Verzögerung
E =
1
15 ms Verzögerung
Fl
Side Select
Flag
Fl
=
0
SSO auf
1
legen
Fl
=
1
SSO auf
0
legen
F2
Sector Length Flag
I
1
I
I
Sector Length Field
.
I
I
I
00
01
01
11
I
I
1
I
b
=
0
I
256
I
512
I
1024
I
128
I
I
b =
1
I
128
I
256
I
512
I
1024
I
Statusregister
Belegung des
Statusregisters
Bit des
Statusregisters
I Typ I
Befehl
I Typ II und
III Befehl
Bit
0
Bit
1
Bit
2
Bit 3
Bit
4
Bit
5
Bit
6
Bit
7
I
I
I
I
I
I
I
I
I
I
I
I
1
= Busy
1
= Index
1
= Spur 0
1
= CRC-Fehler
1
= Such Befehl
I
I
I
I
I
I
1
= Kopf geladenl
1
= Schreib
schutz
1
=
Nicht
ready
0
= ready
I
I
I
I
I
1
=
Busy
1
=
DRQ
1
=
Daten Verlust
1
= CRC-Fehler
1
= Record nicht
gefunden
1
= Record Typ
Typ Fehler
1
= Schreibschutz
1
=
nicht
ready
0
- ready
Weitere Einzelheiten zum 1797
siehe unter
10.2
7.1.3
Der Datenseperator 9229B
(J15)
Der
Datenseperator trennt beim Lesen die wirklichen Daten vom
Takt
und
beaufschlagt
beim
Schreiben die Daten mit
dem
Takt.
Diese
Modulation
und
Demodulation
wurde
früher
immer
durch
eine
Analogschaltung realisiert,
die zu allem Übel auch noch abgeglichen
werden musste.
Durch die integrierte Schaltung des
IC's wird dieser
Abgleich
überflüssig
und die Schaltung ist auch sonst
(durch
die
Integration)
um einiges
störsicherer.
Außerdem
beinhaltet
dieser
Datenseperator
noch
eine
Precompensationsschaltung,
wobei die zu
"compensierenden"
Werte über
JMP7
eingestellt
werden können.
Erklärung
Precompensation
siehe
unter 3.2.
26

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