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Ein- und Aus gangs sig na le
3
Ein- und Aus gangs sig na le
Über sicht
3.1
Nach fol gend sind die Sig na le be schrie ben, die zum Da ten aus tausch zwi schen dem
A(1S)J71DN91 und der CPU der SPS, in der das Mo dul in stal liert ist, zur Ver fü gung ste hen.
Das „n" in der E/A-Adres se steht für die An fangs adres se des De vi ce Net-Mas ter-Mo duls, die
vom Steck platz und von der Adres sen ver ga be ab hän gig ist. Bei der An fangs adres se „X/Y30"
ent spre chen z.B. die Be rei che Xn0 bis X(n+1)F und Yn0 bis Y(n+1)F den Adres sen X30 bis X4F
bzw. Y30 bis Y4F.
Sig nal rich tung: A(1S)J71DN91
Ein gang
Xn0
Xn1
Xn2
Xn3
Xn4
Xn5
Xn6
Xn7
Xn8
bis
XnE
XnF
X(n+1)0
X(n+1)1
X(n+1)2
X(n+1)3
X(n+1)4
X(n+1)5
X(n+1)6
X(n+1)7
X(n+1)8
bis
X(n+1)F
Tab. 3-1:
HINWEIS
Be ach ten Sie bei der Pro gram mie rung, dass es zu Fehl funk tio nen kom men kann, wenn ei -
nes der re ser vier ten Sig na le vom SPS-Pro gramm an ge spro chen (ge setzt oder rück ge -
setzt) wird.
DeviceNet-Master-Module
SPS-CPU
Beschreibung
Watch-Dog-Ti mer-Feh ler (WDT-Feh ler)
E/A-Da ten wer den ak tua li siert.
Mit tei lungs kom mu ni ka ti on beendet
Feh ler bei der Kommunikation
Mind. ein Sla ve kom mu ni ziert nicht mehr.
Feh ler bei der Mit tei lungs kom mu ni ka ti on
Pa ra me ter wer den ein ge tra gen.
Ein trag der Pa ra me ter beendet
Reserviert
Mo dul ist be reit.
Re ser viert
Ein- und Aus gangs sig na le des A(1S)J71DN91
Sig nal rich tung: SPS-CPU
Aus gang
Beschreibung
Yn0
Yn1
Yn2
Yn3
Yn4
Yn5
Re ser viert
Yn6
Yn7
Yn8
bis
YnE
YnF
Re ser viert
Y(n+1)0
E/A-Da ten ak tua li sie ren
Y(n+1)1
Mit tei lungs kom mu ni ka ti on starten
Y(n+1)2
Feh ler mel dung löschen
Y(n+1)3
Y(n+1)4
Re ser viert
Y(n+1)5
Y(n+1)6
Pa ra me ter eintragen
Y(n+1)7
Y(n+1)8
Re ser viert
bis
Y(n+1)F
Über sicht
A(1S)J71DN91
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