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Status Byte Register (STB)
Service Request Enable Register (SRER)
Während der seriellen Abfrage werden die Inhalte des 8-Bit Status Byte Register
vom Instrument an die Steuerung gesendet.
Wenn ein durch das Service Request Enable Register aktiviertes Bit des Status
Byte Register von 0 auf 1 wechselt, wird das MSS-Bit auf 1 gesetzt. Folglich wird
das SRQ-Bit auf 1 gesetzt und eine Sendeanfrage wird ausgegeben.
Das SRQ-Bit wird immer mit Sendeanfragen synchronisiert und wird während
der seriellen Abfrage gelesen und gleichzeitig gelöscht. Auch wenn das MSS-Bit
∗
nur von einer
-Anfrage gelesen wird, wird es erst gelöscht, wenn ein
STB?
Löschen-Ereignis durch einen
Bit 7
Nicht verwendet
Bit 6
SRQ
Steht auf 1, wenn eine Sendeanfrage verschickt wird.
MSS
Die logische Summe der übrigen Bits des Status Byte Register.
Bit 5
Bit des Standardereignisstatus (logisches ODER)
ESB
Die logische Summe des Standard Event Status Register.
Bit 4
Meldung verfügbar
MAV
Zeigt an, dass eine Meldung in der Ausgabewarteschlange
verfügbar ist.
Bit 3
Nicht verwendet
Bit 2
Nicht verwendet
Bit 1
Ereignisstatus (logisches ODER) Bit 1
ESB1
Die logische Summe des Event Status Register 1.
Bit 0
Ereignisstatus (logisches ODER) Bit 0
ESB0
Die logische Summe des Event Status Register 0.
Dieses Register maskiert das Status Byte Register. Indem ein Bit dieses
Registers auf 1 gesetzt wird, kann das entsprechende Bit des Status Byte
Register verwendet werden.
8.4 Kommunikationsmethoden
∗
-Befehl initiiert wird.
CLS
107
8
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