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POST Code Definition
1. Programmiert MTRR des M1 CPU
2. Initialisiert den L2-Cache für den CPU der P6-Klasse & programmiert den CPU
4E
3. Initialisiert APIC für den CPU der P6-Klasse.
4. Regelt den cacheablen Bereich zu einem Kleinerem auf der MP-Plattform, falls die
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Initialisiert USB
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Testet allen Arbeitsspeicher (löscht allen erweiterten Speicher)
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Passwort löschen gemäß H/W Jumper (Option)
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Zeigt die Nummer der Prozessoren an (Multi-Prozessor-Plattform)
Zeigt das PnP-Logo an
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Frühe ISA PnP-Initialisierung
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Initialisiert den kombinierten Trend Anti-Virus-Code.
(Optionale Eigenschaft)
5B
Zeigt Meldungen für AWDFLASH.EXE von dem FDD (optional)
1. Initialisiert Init_Onboard_Super_IO
5D
2. Initialisiert Init_Onbaord_AUDIO
Ok zum Gelangen ins Setup Utility; d.h. dass der Benutzer erst bis zu dieser
60
POST-Stufe in das CMOS Setup Utility gelangen kann.
63
Reset Tastatur, wenn Early_Reset_KB nicht definiert ist
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Initialisiert die PS/2 Maus
Bereitet die Arbeitsspeichergröße-Informationen für den Funktion-Aufruf vor: INT
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15h ax=E820h
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Schaltet den L2-Cache an
Programmiert die Chipsatz-Register entsprechend der Elemente, die in der Setup &
6B
Auto-Konfigurationstabelle beschrieben sind.
1. Weist Ressourcen allen ISA PnP-Geräten zu.
6D
2. Weist automatisch Anschlüsse den Onboard-COM-Anschlüssen zu, wenn das
1. Initialisiert den Floppy-Controller
6F
2. Stellt die mit Floppy relevanten Felder in 40:hardware ein.
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Erkennt & installiert alle IDE-Geräte: HDD, LS120, ZIP, CDROM.....
(Optionale Eigenschaft)
Geben Sie AWDFLASH.EXE ein, wenn :
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77
Erkennt serielle & parallele Schnittstelle.
7A
Erkennt & installiert den Co-Prozessor
7C
Initialisiert Festplatten-Schreibschutz
mit angemessenen cacheablen Bereich.
cacheablen Bereiche zwischen jedem CPU nicht identisch sind.
-Weist CSN jedem ISA PnP-Gerät zu.
entsprechende Element im Setup auf "AUTO" eingestellt ist.
-AWDFLASH im Diskettenlaufwerk gefunden wurde.
-ALT+F2 gedrückt wurde
G-3
Handbuch
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