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3-16
RAS# Precharge Time:
Dieser Punkt gibt die RAS# precharge-Zeit an.
RAS# to RAS# Delay:
Dieser Punkt gibt die RAS# active to RAS# active-Verzögerungszeit der anderen Bank an.
Write Recovery Time:
Dieser Punkt spezifiziert die seit dem letzten vom DRAM gemessenen sicheren Schreibvorgang
verstrichene Zeit.
Write to Read Delay:
Dieser Punkt gibt die Zeit an, die zwischen der auf den letzten unmaskierten Datenimpuls folgenden
ansteigenden Flanke bis zur ansteigenden Flanke des nächsten Lesebefehls gemessen wurde.
Read to Write Delay:
Hier wird der Read to Write Delay (Lesen-Schreiben Verzögerung) eingestellt.
DRAM Command Rate:
Wenn der Host (Northbridge) die gewünschte Speicheradresse findet, verarbeitet es den Wartezustand der
Befehle.
Bank Interleaving:
Je nach der Struktur Ihres SDRAM-Moduls kann die Einstellung "4 Way" die beste Leistung bieten.
Wenn Sie die falsche Einstellung wählen, wird Ihr System nicht stabil laufen. Für detaillierte Information
zu Ihrem SDRAM-Modul wenden Sie sich bitte an den Hersteller.
Burst Length
DDR SDRAM-Module verfügen über einen Burst-Modu, d. h., eine Auto-Precharge-Funktion für
programmierbare READ oder WRITE Burst-Längen von 2, 4 oder 8 Orten.
Diese bedeutet, dass bei einer Einstelung der Burst-Länge auf 8 der Adress-Bus 8 Bytes in jedem Zyklus
für Precharge etc. angeht.
MTRR mapping mode
Hier wird der MTRR-Abbildungsmodus gewählt. MTRR (Memory-Type and Range Registers)
kontrolliert Zugriff und Adressierung von Speicherbereichen des Prozessors.
32 bit Dram Memory Hole:
Hier können Sie die Methode zur Abbildung von 32 Bit DRAM Speichern wählen. Belassen Sie diese
Einstellung auf dem Default-Wert „Auto".
Kehren Sie hier zum Setup-Menü Advanced Chipset Features zurück:
SSE/SSE2 Instructions:
Hier können Sie SSE/SSE2 (Streaming SIMD Extensions) Befehlssätze aktivieren/deaktivieren. Die
Default-Einstellung ist aktiviert.
System BIOS Cacheable:
Zwei Optionen stehen zur Auswahl: Disabled oder Enabled. Die Voreinstellung ist Enabled. Wenn Sie
Enabled wählen, wird das System-BIOS über die L2-Cache schneller ausgeführt.
AN8 32X
Kapitel 3
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