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Steuerregister 2D
ПРАГА РА А С ГЕ
1
0
0
0
0 Chip zurücksetzen;
1 0 0 0 1 gleicht Zeitverhalten ОМА -Тог А ап CPU
ап;
1 0
0
1 0 gleicht Zeitverhalten DMA-Tor В ап CPU
ап;
100
1
10— Bytezähler, laden Startadressen*);
1 0
1 0
0 Ausführung wird bei momentanem Adreß-
stand und voller Blocklänge begonnen
(Restart);
1
0 Interruptfreigabe;
1
1 Interrupt sperren;
0
0 alle Interrupt werden zurückgesetzt;
0
1 Chipfreigabe, Operationen werden
freigegeben;
0 0 0 0
0 Chipsperre, Operationen werden blockiert;
0
1
1
1
0 Lesemaske folgt;
0
1
0
0 1 daserste Register, das durch Lesemaske frei
ist, wird als nächstes gelesen;
0
1
1
1
1 alsnächstes Register wird das Statusregister
gelesen
0
1
1
0
0 erzwungenes КРУ, es wirdinterneinRDY
erzeugt;
0
1
1
0
1 vomDMA kommt keine Busanforderung,
solange das RETI nicht kommt;
0
0
0
1
0 Rücksetzen Vergleichs-Bit und Blockende-
ооо
о
Se
arm.
Bit im Statusregister.
Statusregister
D,
На
По
На
D;
Blockende-Bit,0 = Blockende
D, | Vergleichs-Bit,0 = Vergleich
з
OINT-Pending
* Bekommt der betreffende Kanal eine Festadresse, so ist das Laden der Startadresse
(für Festadresse) nur möglich, wenn dieser Kanal als Eingabekanal definiert ist.
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