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M 001 DIGITAL IN/OUT
3.4.
Peripherieanschlußbedingungen
3.4.1. Peripherieanschlußbelegung
Der Modul verfügt über eine 26-polige Buchsenleiste für direkten Anschluß.
Die Buchsenleiste ist das Koppelelement zur extern angeschlossenen Peripherie.
Im Bild 2 ist die Peripherieanschlußbelegung dargestellt. Die Darstellung
zeigt den Blick auf die Frontplatte des Moduls.
Port A
0
1
1 2
3
Port B
0
1
Bild 2: Peripherieanschlußbelegung
Pin 1 A/B
-
Pin 2 bis 9 A
-
Pin 2 bis 9 B
-
Pin 10 A
-
Pin 10 B
-
Pin 11 A
-
Pin 11 B
-
Pin 12 A
-
Pin 13 A
-
Pin 12 B
-
Pin 13 B
-
3.4.2. Elektrische Bedingungen
Für die am Peripherieanschluß herausgeführten Signale (PIO Port A und B
mit Quittungssignalen und die CTC Kanäle 0 und 1) gelten folgende elektri-
schen Bedingungen:
2
3
4
5
4
5
6
7
2
3
4
5
Masse
PIO Port A (A0-A7)
PIO Port B (B0-B7)
STB A (PIO Port A Quittungssignal, Eingang)
STB B (PIO Port B Quittungssignal, Eingang)
RDY A (PIO Port A Quittungssignal, Ausgang)
RDY B (PIO Port B Quittungssignal, Ausgang)
CLK/TRG0 (CTC Kanal 0, Clock/Trigger-Eingang)
CLK/TRG1 (CTC Kanal 1, Clock/Trigger-Eingang)
ZC/TO0 (CTC Kanal 0, Nulldurchgangssignal, Ausgang)
ZC/TO1 (CTC Kanal 1, Nulldurchgangssignal, Ausgang)
6
7
STB
RDY TR0
8
9
10
11
6
7
STB
RDY ZC/
11
CLK/ CLK/
TR1
A
12
13
ZC/
B
TO0
TO1
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