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Omni TA
Reg.
Bits
Bin
S43
S44
3
4
S45
1-0
S46
1-0
S56
S61
3
Dez
Hex Erläuterungen
Geschwindigkeit von DTE-Port 2 in bps
1
2
3
4
5
6
7
Bitkodiertes Register
8
8 Zyklische Anwahl für
ATDSn aktivieren
16
10 DSR folgt DTR
Flußsteuerung von DTE-Port 2
00
0
0 Keine Flußkontrolle
01
1
1 Hardware (RTS/CTS)
Flußsteuerung
10
2
2 Software (XON/XOFF)
Flußsteuerung
Einstellungen für DTE-Port 2
00
0
0 Keine Parität, 8 Datenbits,
1 Stopbit
01
1
1 Gerade Parität, 7
Datenbits, 1 Stopbit
10
2
2 Ungerade Parität, 7
Datenbits, 1 Stopbit
0-
0-
Dauer des Flash-Impulses
255
FF
für a/b-Adapter in
Einheiten von 10ms
Bitkodiertes Register
0
0
0 Kanalbündelung nach
Rotationsverfahren
1
8
8 Kanalbündelung nach
Splitverfahren
115200
76800
57600
38400
19200
9600
2400
19–11
Beschreibung der S-Register
Vor.
Ref.
1
+
*A1
*A2
*A3
*A4
*A5
*A6
*A7
0
DSn
&S1
S41.5
1
*M0
+
*M1
*M2
0
+
*N0
*N1
*N2
50
0
+
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